Comprobación de reglas eléctricas

El comando Output | Reports | Electrical Rules Check en el editor esquemático abre el cuadro de diálogo Electrical Rules Check Setup, que incluye controles para configurar el ERC. 

Cuadro de diálogo de configuración de la comprobación de reglas eléctricas

El cuadro de diálogo Electrical Rules Check Setup contiene tres pestañas, cada una de las cuales se describe en esta página.

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Pestaña Columns

• Validation - use la lista desplegable para definir el nivel máximo de error tolerado al usar el generador de salida ERC como parte de la validación durante el proceso de liberación del diseño de la placa. 
• Report Suppressed Errors - habilite esta opción para informar de cualquier error suprimido.
• Show Columns - elija qué columnas se mostrarán en el informe ERC. A medida que se realizan selecciones, la región Preview se actualiza para mostrar la configuración de las columnas.
• Preview - muestra los errores actuales detectados para el diseño según la validación que utiliza la comprobación de errores definida en las pestañas del cuadro de diálogo. Si cambia un nivel de comprobación, el diseño se vuelve a validar dinámicamente y la región de vista previa se actualiza. Use las opciones de la región Show Columns para alternar la visualización de las columnas correspondientes dentro del área de vista previa.

Pestaña Error Reporting

Esta pestaña le permite definir los niveles de informe para cada una de las posibles infracciones que pueden existir en los documentos esquemáticos de origen al validar el proyecto. Cuando se valida el proyecto, esta configuración de infracciones se utilizará junto con la pestaña Connection Matrix para comprobar si hay infracciones en los documentos de origen. Cualquier infracción encontrada que tenga un nivel de informe de No Report,  Warning,  Error, o Fatal Error se mostrará en el panel Messages panel. Además, si los errores y advertencias del compilador están habilitados para mostrarse en el esquemático (habilitado en la página Schematic Compiler de System Preferences), un objeto infractor mostrará una línea ondulada de color debajo.

Cuadrícula de infracciones

Esta región presenta todas las posibles infracciones que pueden existir en los documentos de origen del proyecto. Las infracciones se agrupan en las siguientes categorías:

• Infracciones asociadas con componentes
• Infracciones asociadas con documentos
• Infracciones asociadas con redes
• Infracciones asociadas con otros

Tips

• Use la pestaña Connection Matrix para especificar los niveles de informe asociados con infracciones eléctricas relacionadas específicamente con pines, puertos y entradas de hoja.
• Puede haber puntos en el diseño que usted sabe que se marcarán como infracciones eléctricas y que no desea que se marquen. Para suprimirlas, coloque un objeto de directiva de diseño esquemático No ERC en esos puntos.
• En general, es mejor validar primero el diseño y examinar las advertencias con la configuración predeterminada. Para aquellas advertencias que no sean un problema para el diseño actual, se puede cambiar el nivel de informe.

Pestaña Connection Matrix

Esta pestaña muestra una matriz que proporciona un mecanismo para establecer reglas de conectividad entre los pines de los componentes y los identificadores de red, como Ports y Sheet Entries. Define las condiciones lógicas o eléctricas que deben informarse como advertencias o errores. Por ejemplo, un pin de salida conectado a otro pin de salida normalmente se consideraría una condición de error, pero dos pines pasivos conectados no.

Cuando se valida el proyecto, esta configuración de infracciones se utilizará junto con la configuración definida en la pestaña Error Reporting para comprobar si hay infracciones en los documentos de origen. Cualquier infracción encontrada que tenga un nivel de informe de No Report, Warning, Error, o Fatal Error se mostrará en el panel Messages. Además, si los errores y advertencias del compilador están habilitados para mostrarse en el esquemático (habilitado en la página Schematic Compiler de System Preferences), un objeto infractor mostrará una línea ondulada de color debajo.

Matriz

La matriz presenta todas las posibles comprobaciones de conexión de cableado, entre combinaciones de pines, puertos y entradas de hoja, así como pruebas para entidades no conectadas. La matriz se lee de forma horizontal/vertical y el color del elemento de la matriz en la intersección fila-columna especifica cómo responderá el compilador al comprobar esa condición en particular.

Para cambiar el modo de informe de una comprobación de infracción en la matriz, haga clic en el cuadrado de color donde se cruzan la fila y la columna de dos entidades. Cada vez que haga clic, el modo pasará al siguiente nivel de informe.

Tips

• Use la pestaña Error Reporting para especificar los niveles de informe asociados con otras infracciones eléctricas y de delineación.
• Puede haber puntos en el diseño que usted sabe que se marcarán como infracciones eléctricas y que no desea que se marquen. Para suprimirlas, coloque un objeto de directiva de diseño esquemático No ERC en esos puntos.