CircuitStudio ドキュメント
CircuitStudio® は、プリント基板を時折設計する方に向けて、プロフェッショナルレベルのツールを手元で使える強力な設計ソリューションを提供します。強力なPCB設計エンジンの上に構築された洗練されたインターフェースにより、CircuitStudio は基板の回路図作成とレイアウトに必要なツールを提供し、アイデアを物理的な現実へと変えるための製造データを、単一の強力でありながら直感的な統合設計環境の中ですべて作成できます。
はじめに
設計コンポーネント
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CircuitStudio は、設計で使用するコンポーネントの扱い方について、好みのアプローチに合わせられる多様なコンポーネント管理手法を提供します。
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Standard Component Libraries - 回路図シンボル(
*.SchLib)および PCB 2D/3D コンポーネントモデル(*.PcbLib)ライブラリ。 - Integrated Components - このモデルでは、上位レベルのコンポーネントは回路図ライブラリファイル(*.SchLib)内の回路図シンボルとしてモデル化されます。その他のモデルはシンボルからリンクされ、コンポーネントパラメータはシンボルに追加されます。すべてのソースライブラリ(シンボルおよびリンクされたモデル)は Library Package プロジェクト(*.LibPkg)内で定義され、その後、単一の統合ライブラリファイル(*.IntLib)にコンパイルされます。統合ライブラリにコンパイルする利点は、すべてのコンポーネント情報が単一の携帯可能で安全なファイルとして利用できる点にあります。
- Vault Components - この「次世代」モデルは、従来の電子設計領域における設計コンポーネントの概念を、より大きな「製品領域」において組織全体から見たコンポーネントへと効果的に対応付けます。これは、異なる設計ドメイン(回路図キャプチャ、2D/3D PCB レイアウト)におけるコンポーネント表現にとどまらず、現実世界の物理コンポーネント情報まで含めて拡張され、設計領域とサプライチェーン領域にまたがる、あるいはそれらを統合するコンポーネント、すなわち Unified Component を作成します。
リソース参照
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CircuitStudio の統合設計環境は、コアプラットフォームにプラグインされたさまざまな Servers で構成されています。コアプラットフォーム自体と合わせて、これらのサーバーがソフトウェアのリソース(機能および機能性)を提供します。これらはコマンド、ダイアログ、パネルなどの形で提供されます。これらのリソースはサーバーによって文書化・集約されています。特定のリソースに関する情報を見つけるには、次の方法を使用してください。
- ソフトウェア内で、リボンボタン、メニューコマンド、ダイアログ、パネル、または設計オブジェクトにマウスカーソルを合わせ、F1 を押します。
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ドキュメント内では、次のいずれかを行います。
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このテキストの左側にあるポップアップのナビゲーションツリー(ページ左上の
ボタンをクリックして表示)を使用し、各サーバーにまたがって必要なリソースを参照します(ツリーの Resource Referenceセクション配下)。 - 右上の Search フィールドを使用します。
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このテキストの左側にあるポップアップのナビゲーションツリー(ページ左上の
以下のセクションでは、リソースドキュメント内の主要領域を強調し、素早く移動できるようにしています。
設計環境
回路図キャプチャ
PCB 設計
テキスト編集
PCB 設計ルール参照
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CircuitStudio の PCB エディタは、設計要件を定義するために Design Rules の概念を使用します。これらのルールはまとめて、PCB エディタが従うべき「命令セット」を形成します。配線幅、クリアランス、プレーン接続スタイル、ビアスタイルなど、設計のあらゆる側面をカバーし、多くのルールはオンライン Design Rule Checker(DRC)によってリアルタイムに監視できます。
設計ルールは特定のオブジェクトを対象とし、階層的に適用されます。同一タイプのルールを複数設定することも可能です。ある設計オブジェクトが、同じスコープを持つ複数のルールに該当する場合があります。この場合、競合が発生します。競合はすべて優先度設定によって解決されます。システムは優先度の高いルールから低いルールへ順に評価し、チェック対象のオブジェクトにスコープが一致する最初のルールを採用します。
明確に定義された設計ルール一式があれば、さまざまな、そしてしばしば厳しい設計要件を持つ基板設計を成功裏に完了できます。さらに、PCB エディタはルール駆動であるため、設計開始時に時間をかけてルールを設定しておけば、ルールシステムが成功を確実にするために強力に機能しているという安心感のもとで、設計作業を効率的に進められます。
次の設計ルールカテゴリが利用可能です。
プロジェクトコンパイラ違反参照
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コンパイルのプロセスは、プロジェクトに対して有効なネットリストを生成するうえで不可欠です。実際、コンパイルによって設計の統合データモデルが生成されます。これは、CircuitStudio の統合設計環境において設計ドメイン全体でアクセス可能な、単一のデータモデルです。回路図における接続性の認識は、Error Reporting および Connection Matrix タブの設計プロジェクトオプションの一部として定義されたルールに従い、コンパイル中に検証できます。
CircuitStudio ドキュメントのこの領域では、プロジェクトをコンパイルする際にソースドキュメント内に存在し得る各種の電気的違反および作図(ドラフティング)違反について、包括的な参照情報を提供します。違反のカテゴリは次のとおりです。