プロジェクトオプション - 接続マトリクス

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Connection Matrixタブ(Options for PCB Project dialog 内)Connection Matrixタブ(Options for PCB Project dialog 内)

概要

このOptions for PCB Project dialog のタブでは、コンポーネントのピンと、ポートやシートエントリなどのネット識別子との間で接続ルールを確立するための仕組みとして、マトリクスを提供します。ここでは、警告またはエラーとして報告すべき論理的/電気的条件を定義します。たとえば、出力ピンが別の出力ピンに接続されている場合は通常エラー条件と見なされますが、パッシブピン同士の接続はそうではありません。

プロジェクトをコンパイルすると、これらの違反設定が(Error Reportingタブで定義された設定と併せて)使用され、ソースドキュメントの違反がテストされます。見つかった違反のうち、報告レベルが Warning、Error、Fatal Error のものは、違反メッセージとして Messages panel に表示されます。さらに、回路図上にコンパイラのエラー/警告を表示する設定が有効な場合(Preferences dialog の Schematic - Compiler ページで有効化)、問題のあるオブジェクトの下に色付きの波線が表示されます。

コンパイルのプロセスは、プロジェクトに対して有効なネットリストを生成するうえで不可欠です。実際、コンパイルによって設計の統合データモデルが得られます。これは、CircuitStudio の統合設計環境において、設計ドメイン全体でアクセス可能な単一のデータモデルです。ネットリスト生成の前に、報告されたすべてのエラーを注意深く確認し、解決してください。
プロジェクトのコンパイル時にソースドキュメント上で発生し得る電気的違反および作図(ドラフティング)違反の各項目について包括的に説明したリファレンスは、Project Compiler Violations Reference を参照してください。

アクセス

これは、プロジェクトのオプションを設定する際に利用できる複数のタブのうちの1つで、Options for PCB Project dialog 内からアクセスします。このダイアログは次の方法で開きます。

  • 回路図エディタまたは PCB エディタのメインメニューから Project | Content | をクリックします。
  • Projects panel 上でプロジェクト自体のエントリを右クリックし、コンテキストメニューから Project Options を選択します。

オプション/コントロール

接続マトリクス

このマトリクスは、ピン、ポート、シートエントリの組み合わせ間で考えられるすべての配線接続チェックに加え、未接続エンティティのテストも提示します。マトリクスは横/縦の方向で読み取り、行と列の交点にあるマトリクス要素の色が、その条件をテストする際にコンパイラがどのように応答するかを示します。

マトリクス内の違反チェックの報告モードを変更するには、2つのエンティティの行と列が交差する位置にある色付きの四角をクリックします。クリックするたびに、モードは次の報告レベルへ移動します。次のレベルがサポートされています。

四角にカーソルを合わせると、マトリクスの下にテキストが表示され、接続違反の内容と適用中の報告モードが説明されます。

右クリックメニュー

このタブの右クリック(コンテキスト)メニューからは、次のコマンドを利用できます。

  • All Off - マトリクス内のすべてのエントリを No Report に設定します。
  • All Warning - マトリクス内のすべてのエントリを Warning に設定します。
  • All Error - マトリクス内のすべてのエントリを Error に設定します。
  • All Fatal - マトリクス内のすべてのエントリを Fatal に設定します。
  • Default - マトリクス内のすべてのエントリを既定の設定に戻します。

追加オプション

  • Set To Installation Defaults - このボタンをクリックすると、マトリクス内のすべてのエントリが既定の設定に戻ります。
既定のマトリクス設定は一般的には適切ですが、特定の設計要件に合わせて容易に調整できます。

注記

  1. Options for PCB Project dialog の Error Reporting タブを使用して、追加の電気的違反および作図(ドラフティング)違反に関連する報告レベルを指定します。
  2. 設計上、電気的違反としてフラグ付けされることが分かっている箇所があり、それをフラグ付けしたくない場合があります。これらを抑制するには、各箇所に No ERC の回路図設計ディレクティブオブジェクトを配置してください。

 

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