Altium Designer の新機能

Created: 12月 13, 2023 | Updated: 8月 23, 2024 | Applies to version: 24

このページでは、Altium Designer 24 の初期バージョンに含まれる改善点と、その後の更新で追加した改善点について説明します。様々な改善を提供することに加えて、各更新には、AltiumLive コミュニティの BugCrunch システムを通じてお客様から寄せられたフィードバックに基づいて、ソフトウェア全体に多数の修正と拡張機能を導入し、設計者が最先端の電子技術を作成し続けるのに役立ちます。

現在のバージョンを使用し続けるか、現在のバージョンを更新、または現在のバージョンと一緒に Altium Designer 24 をインストールして最新の機能を利用するか選択できます。現在のバージョンは、ソフトウェア内の Extensions and Updates 画面で更新できます。現在のバージョンと一緒に AltiumDesigner 24 をインストールする場合は、Altium Downloads ページからインストーラーをダウンロードし、インストーラーの Installation Mode ページで New Installation を選択します。

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まだ、Altium Designer を所有されていない場合、Altium Designer を試してみてはいかがですか? 簡単なフォームを入力して、製品版と同等の機能で 15 日限定の Altium Designer の評価版をお試し頂けます。技術的な制限無く、Altium Designer を自由に評価できます。以下のリンクをクリックしてフォームを入力してください。そして、より多くの技術者や設計者が他の製品より Altium を選択する理由をご自身でお確かめください!

Altium Designer 無償評価版

Altium Designer 24.8

リリース日: 2024年8月21日 – バージョン 24.8.2 (build 39)

Altium Designer のリリースノート

PCB デザインの改善

単層 PCB の対応 (Open Beta)

このバージョンでは、レイヤ構成マネージャ、PCB や Draftsman ドキュメント、生成された出力で対応する、単層 PCB を作成する機能を追加しました。

この対応により、レイヤ構成マネージャで 2 層構成から top layer、または bottom layer のいずれかを削除できるようになりました。

2 層 PCB では、レイヤ構成から Top、または Bottom Layer のいずれかを削除できるようになりました。

単層構成は PCB に対しては作成できますが、フットプリントに対しては作成できません。
レイヤ構成が 1 つの銅箔層の場合、レイヤ構成マネージャの Via Types タブや Back Drills 機能は利用できません。また、単層 PCB の場合、レイヤ構成マネージャの Impedance タブでは、Single-Coplanar と Differential-Coplanar タイプのインピーダンスプロファイルのみを作成できます。
Tools » Presets メニューに、単層構成のプリセットが含まれるようになりました – 画像を表示。

PCB に単一の信号層がある場合、それは PCB エディタのユーザインターフェース (レイヤタブ、board の Properties パネル、および View Configuration パネル) と PCB のレイヤ構成テーブル、およびドリルテーブルに反映されます。

削除した層は、該当する場合は side として参照されます。例えば、bottom layer を削除した場合、下図に示すように、ドリルテーブルの Drill Layer Pair 列では Bottom Side と表示されます。

単層 PCB は、Draftsman ドキュメント、および次の出力で対応しています: Gerber、Gerber X2、ODB++、IPC-2581、Pick and Place、NC Drill、Layer Stack Report、PCB 印刷。

単層 PCB に unplated スルーホールパッドが存在する場合、DRC report の Unplated multi-layer pad(s) detected の項目ではフラグされません。

この機能は、Open Beta であり、Advanced Settings ダイアログで PCB.SingleLayerStack.Support オプションを有効にした場合に利用できます。

詳細については、Defining the Layer Stack のページをご参照ください。

定義済みの Donut (ドーナツ) パッド形状 (Open Beta)

パッドスタックを定義する時に使用できるパッド形状のリストへ、定義済みの丸い Donut 形状を追加しました。パッドへ Donut 形状を適用するには、Properties パネルの Shape ドロップダウンを使用します。丸い Donut 形状は完全な円として表され、PCB List パネル、Find Similar Objects ダイアログ、expression の使用時に対応します。また、Paste/Solder Mask layer や、ポリゴンへのサーマルリリーフ接続箇所を定義する時にも対応します。

丸い Donut パッドの形状の外径は D で表され、幅は Properties パネルで W で表されます (上図で紫色でハイライト表示されています)。値を変更するには、それぞれのセルをクリックします。

丸い Donut パッドの形状は、ODB++、Gerber、Gerber X2、PCB 印刷、IPC-2581、DXF/DWG 出力、および PCB ドキュメントの比較時に PCB CoDesigner で対応します。また、丸い Donut パッドは、Xpedition デザイン/ライブラリをインポートする時にも対応します。

パッドテンプレートを定義する時、IPC-7351 基準に従って自動命名が適用されます。

Donut 形状パッドを使用した PCB を以前のバージョンのソフトウェアで開いた時、その情報は失われます。実際、Donut 形状は単に一連のアークへ変換されます。

この機能は、Open Beta であり、Advanced Settings ダイアログで PCB.Pad.CustomShape.Donut オプションを有効にした場合に利用できます。

詳細については、Working with Pads & Vias のページをご参照ください。

Routing Neck-down ルール (Open Beta)

このバージョンでは、基板の密集した領域での配線を支援するために、新しい routing neck-down デザインルールを導入しました。

最新のコンポーネント技術では、配線が基板上を移動するにつれて、ネットが異なる幅で配線されることは珍しくありません。例えば、BGA への配線や BGA からの配線では、適用されたインピーダンスプロファイルで許可されている優先幅の配線よりも狭いエスケープ配線が必要になることがよくあります。新しいルールでは、このような狭いトレースの最大許容合計配線長を定義して、必要なインピーダンスを適用した配線を行えます。

Routing Neck-Down ルールは、制約マネージャの Physical ビューと PCB Rules and Constraints Editor ダイアログの両方で定義できます。Neck-Down Length 欄を使用して、Routing Width ルールで定義された Min Width と Preferred Width 間にある連続配線 (ルールによってスコープされる各ネット内) の最大許容配線長を定義できます。

Min Width ≤ Actual Neck-down Width < Preferred Width

または、表を使用して、レイヤごとに許容される配線長を定義できます。

対応する DRC モードで Routing Neck-Down ルールの違反を検出するには、Design Rule Checker ダイアログでオンラインチェックと/または、バッチチェックの Routing Neck-Down ルールタイプチェックを有効にします。検出されたルール違反は、デザインスペース内の対応するトレース上に格子状パターンで示されます。

この機能は、Open Beta であり、Advanced Settings ダイアログで PCB.Rules.RoutingNeckdown オプションを有効にした場合に利用できます。

詳細については、Routing Rule Types のページをご参照ください。

配線 Auto-shrinking (Open Beta)

インタラクティブルーターを使用して配線されているトレースが、現在、選択されている配線幅では障害間を配線できない時、この新しい機能により、この場所でトレースを配線できる値まで幅を自動で縮小できます (この縮小されたトレースが、対応する制約の最小許容幅に違反しないことが条件です)。この機能を有効にするには、Preferences ダイアログの PCB Editor – Interactive Routing page ページや、インタラクティブ配線中に Properties パネルで Auto Shrinking オプションを有効にします。

auto-shrinking は、Ignore Obstacles や Stop At First Obstacle 配線障害回避モードでは適用されないことに注意してください。Available Routing Conflict Resolution Modes の詳細をご覧ください。

この機能は、Open Beta であり、Advanced Settings ダイアログで PCB.Routing.EnableAutoShrinking オプションを有効にした場合に利用できます。

詳細については、Interactive Routing のページをご参照ください。

Trace Centering (Open Beta)

多くの設計者の共通の要望は、可能な限り、パッド、またはビア間を通過する配線を中央に配置することです。配線エンジンの現在の動作は、デザインルールで定義された最小許容クリアランスにトラックセグメントを配置し、パッド間の配線を広げる、または中央に配置する作業を残すと言うものです。

新しい centering 機能は、配線、またはドラッグされているネットと既存のパッド/ビア間にクリアランスを追加することで、centering プロセスを支援します。配線エンジンは、この追加のクリアランスは必須ではなく望ましいものであると認識しているため、例えば、既存のパッド/ビア間に 2 番目、または 3 番目の配線を押しのける場合等、必要に応じて、クリアランスの一部、または全てを取り戻すことができます。配線エンジンがクリアランスの一部を取り戻す必要がある場合、配線の両側からクリアランスを取り戻し、可能な限り中央に維持します。

trace centering 動作は、Preferences ダイアログの PCB Editor – Interactive Routing ページや、interactive routing、interactive differential pair routing、または interactive sliding 中に Properties パネルで利用できる新しいオプションを使用して設定できます。

Apply Trace Centering – trace centering 機能を有効にします。有効にすると、以下のオプションを利用できます:
- Adjust Vias – このオプションを有効にすると、可能な限り追加のクリアランスを維持するためにビアが押しのけされます。
  trace centering によってビアが押しのけられるのを防ぐには、以下のいずれかの方法を実行します:
  - Adjust Vias オプションを無効にします。この場合、ロックされていないビア間の centering は適用されません。または
  - Allow Via Pushing オプションを無効にします。この場合、ビアは押しのけられません (Clearance 制約からの最小クリアランスを確保するためでも)。
- Added Clearance Ratio – 適用可能なクリアランスの乗数。これがクリアランスに加算されます。例えば、適用可能なクリアランスが 0.15mm の場合、オプションを 2 に設定すると、配線エンジンは、既存のパッドとビアを可能な限り 0.15 + 2*0.15 = 0.45mm だけ許可するように指示されます。配線エンジンは、必要に応じて、このクリアランスを指定されたクリアランスまで減らすことができます。
Disable Trace Centering When Dragging – このオプションを有効にすると、interactive sliding 中に trace centering は適用されません (Apply Trace Centering オプションが有効になっている場合でも)。

Preferences dialog ダイアログの trace centering オプション

Properties パネルの trace centering オプション

パッドとビアの周囲にクリアランスを追加して、配線を中央に配置できます。

この機能は、Any Angle を含む全ての配線モードで利用できます。

この機能は、Open Beta であり、Advanced Settings ダイアログで PCB.EnableTraceCentering オプションを有効にした場合に利用できます。

詳細については、Interactive Routing のページをご参照ください。

真の Zero Mitering (Open Beta)

interactive routing、interactive differential pair routing、または interactive sliding 中に、Miter Ratio の値が 0 に設定されている場合 (対応する Properties パネル、または Preferences ダイアログの PCB Editor – Interactive Routing ページで)、miter が作成されなくなり、鋭角のコーナーを作成できるようになりました。以前のバージョンでは、Miter Ratio = 0 の場合、隣接するトレースによって完全に覆われた短い miter が作成されました。

インタラクテイブ配線中のトラック間の zero-miter 接合の例。

この機能は、Open Beta であり、Advanced Settings ダイアログで PCB.ZeroMitersRemoving オプションを有効にした場合に利用できます。

詳細については、Interactive Routing のページをご参照ください。

制約マネージャの改善

読み取り専用ドキュメントからインポートされたディレクティブの変更

読み取り専用ドキュメント (例えば、デバイスシートや管理されたシート) からインポートされたディレクティブは、Preferences ダイアログの Data Management - Device Sheets ページで Make Device Sheets In Projects Read-Only オプションが有効 (チェック) の場合は変更できません。このオプションが無効 (チェック無し) の場合は、ディレクティブを変更できます。

ディレクティブがインポートされると (オプションが有効の場合)、制約マネージャでルールが青色でハイライト表示されます。

詳細については、Defining Design Requirements Using the Constraint Manager のページをご参照ください。

Advanced Rules を有効/無効にする機能

PCB から制約マネージャにアクセスした時、All Rules ビューで定義されている advanced rules を有効/無効にできるようになりました。

ビューに新しい Enabled 列を追加しました。この列には、各 advanced rule の状態 (True (有効)、または False (無効)) が反映されます。列のセルをダブルクリックして、特定の advanced rule の状態を切り替えます。または、Rule Class ツリーの対応するエントリを右クリックして表示されるコンテキストメニューのコマンドを使用して、特定のタイプ、カテゴリの advanced rules、または全ての advanced rules の有効状態を切り替えます。

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Enabled 列には、各 advanced rule の状態が反映されます。

特定の advanced rule の状態を切り替えるには、Enabled 列のセルをダブルクリックします。

Rule Class ツリーでルールタイプエントリを右クリックして、このタイプの advanced rules を有効/無効にできます。

Rule Class ツリー内のルールカテゴリエントリを右クリックして、このカテゴリの advanced rules を有効/無効にできます。

Rule Class の表題を右クリックして、全ての advanced rules を有効/無効にできます。

詳細については、Defining Design Requirements Using the Constraint Manager のページをご参照ください。

層ごとに制約値を設定する機能

回路図から制約マネージャにアクセスした時、選択したレイヤスタック内の層の Width と Differential Pairs Routing 制約を設定できるようになりました。

制約マネージャの上部にある新しいドロップダウンを使用して、設計プロジェクトの特定の PCB ドキュメントのエントリを選択します。選択した PCB に複数のレイヤスタックが含まれている場合、対応するルールを選択した時に、制約マネージャの下部にあるタブを使用して、制約を設定する必要があるスタックを選択できます。また、選択したインピーダンスプロファイル (選択した PCB のレイヤスタックの一部として定義されている場合) を使用することもできます。

詳細については、Defining Design Requirements Using the Constraint Manager のページをご参照ください。

デザイン間の制約のインポート/エクスポート

デザイン間で制約をエクスポート、およびインポートする機能を追加しました。この新しい機能を利用するには、制約マネージャの Clearances、Physical、または Electrical ビューで右クリックし、Export » Export Constraints for selected lines、または Import » Import Constraints を選択します。

制約のエクスポート

Clearances ビューでセルを選択するか、Physical、または Electrical ビューで行を選択し、Export » Export Constraints for selected lines を選択すると、表にリスト表示されているコマンドを選択する前に選択されていた全てのオブジェクトの制約を含む Constraints for Export ダイアログが開きます。チェックボックスを使用して、エクスポートしたい制約を選択します (現在のビューに関連する制約が、ダイアログでデフォルトで選択されます)。OK をクリックすると、選択した制約が拡張子 *.CstrDot のファイルへエクスポートされます。それから、このファイルを別のデザインへインポートできます。

制約のインポート

Import » Import Constraints を選択した後、標準の File Explorer ダイアログが開き、インポートする *.CstrDot ファイルを選択できます。開いた Constraints for Import ダイアログで、ファイルからインポートしたい制約を選択し、OK をクリックします。選択した制約は、対象のデザインの対応するオブジェクトへ適用されます。

インポートのために選択したネットが対象のデザインに存在しない場合、そのネットのエントリが制約マネージャへ追加されます。デザインにそのようなネットが無いため、エントリには
アイコンが表示されます。このエントリから制約値をコピーして、既存のオブジェクトへペーストできます。同じネットを持つネットをデザインへ追加し、制約マネージャでデータを更新することで、この問題を解決できます。または、エントリを右クリックして Delete unmatched object を選択することで、不一致のオブジェクトを制約マネージャから削除できます – 画像を表示。
インポートのために選択された diff pair、または xNet が対象のデザインに存在しない場合、デザインへ追加されません。
インポートのために選択された net / diff pair / xNet class が対象のデザインに存在しない場合、自動でデザインへ追加されます。

詳細については、Defining Design Requirements Using the Constraint Manager のページをご参照ください。

3D-MID デザインの改善

複数のコンポーネントをドラッグする機能

3D-MID ドキュメントでは、複数のコンポーネントをドラッグできるようになりました。複数のコンポーネントを選択し (ショートカット Shift+Click、またはその他の選択方法を使用して)、選択したコンポーネントを クリックしたままドラッグ すると、選択した全てのコンポーネントを一度に移動できます。

詳細については、3D-MID Design のページをご参照ください。

3D Substrate ファイル名の表示

3D substrate ファイルの名称 (および、フルパス) が Properties パネルに表示されるようになりました。3D-MID ドキュメントでオブジェクトが選択されていない時、パネルの Parameters タブを開き、Pcb 3d Substrate File Name パラメータに表示されます。

メインメニューの File » Change Substrate コマンドを使用して 3D substrate を変更すると、Pcb 3d Substrate File Name パラメータ値が更新されます。3D substrate ファイルの名称を変更した場合 (例えば、Windows File Explorer を介して)、更新されないことに注意してください。

詳細については、3D-MID Design のページをご参照ください。

ハーネスデザインの改善

Draftsman でコメントを配置する機能

Draftsman ドキュメント (*.HarDwf) へコメントを追加する機能を追加しました。コメントはユーザが追加するメモで、ポイント、オブジェクト、または領域へ適用でき、他のユーザが返信できます。配置は、Place メニュー、右クリックのコンテキストメニュー、デザインスペースの右上にある
アイコン、またはショートカットキー Ctrl+Alt+C を使用して行うことができます。Draftsman ドキュメントに配置されたコメントを下図に示します。

詳細については、Document Commenting のページをご参照ください。

BOM でのレイアウトラベルテキストの表示

このバージョンでは、レイアウトラベルのテキスト値を BOM に表示する機能を追加しました。レイアウトラベルのテキストを表示するには、ActiveBOM ドキュメント、または Draftsman ドキュメントに配置された BOM table の Label Text 列を有効にします。レイアウトラベルは、Type が Standard に設定されている時、BOM に表示されることに注意してください。

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Layout Drawing のレイアウトラベルの Type プロパティが Standard に設定されています。

ActiveBOM ドキュメントで、Properties パネルを使用して、BOM の Label Text 列の表示を有効にします。

Draftsman ドキュメントで、Properties パネルを使用して、BOM table の Label Text 列を選択した時にその列の表示を有効にします。

詳細については、Creating the Layout Drawing のページをご参照ください。

Crimp-type Cavity の Strip Length と Pull Off Length の対応

Wiring Diagram (*.WirDoc) で crimp-type cavity を定義する時、Strip Length と Pull Off Length を指定できるようになりました。

両方のプロパティは、Draftsman document (*.HarDwf) の wiring list と connection table オブジェクトに含まれており、列の表題は以下の通りになります:

wiring list の場合:
- FromCrimpStripLength
- FromCrimpPullOffLength
- ToCrimpStripLength
- ToCrimpPullOffLength
connection table の場合:
- CrimpPullOffLength
- CrimpStripLength

詳細については、Defining the Wiring Diagram のページをご参照ください。

プラットフォームの改善

.NET 6 への切り替え

このバージョンでは、Altium Designer は .NET Framework 4.8 から .NET 6 の使用に切り替わります。この切り替えの主な理由は、Microsoft が .NET Framework を廃止したためです。Microsoft は、今後、何年もサポートを続けますが、新しい機能は追加されません。全ての新しい開発と機能は、.NET 6 が含まれる .NET Core ファミリーで行われます。そのため、ある時点で切り替えが必要になります。

更に、.NET 6 は .NET Framework よりもはるかに高速です。弊社のテストでは、回路図と Draftsman で大きな改善が見られました。BOM、コンパイル、ライブラリ作成等、その他の多くの領域では、小さな改善が見られます。

最後に、.NET Framework をインストールする必要はありません。.NET 6 を Altium Designer にバンドルできます。これにより、.NET Framework のインストールや Windows の更新による干渉によって発生する問題が解消されます。

.NET 6 と互換性がないことが判明したサードパーティの拡張機能は、このバージョン以降、ソフトウェアから削除されています。後でこれらの拡張機能の更新バージョンが Altium Designer 24.8 (または、それ以降) と互換性を持つように作成された場合は、beta.program@altium.com に連絡して、インストールに再度、追加してもらってください。

詳細については、System Requirements のページをご参照ください。

データ管理の改善

コンポーネントの新しい 'Number of Pads Exceeds Number of Pins' チェック

Workspace コンポーネントに設定できる validation チェックの一部として、新しい Number of Pads exceeds Number of Pins 違反タイプを追加しました。このタイプの違反は、検証対象のコンポーネントへ割り当てられたフットプリントモデルのパッドの数が、コンポーネントの回路図シンボルモデルのピンの数を超えた場合に起こります。

この例では、コンポーネントに対して 2 つの違反が表示されます – パッドの数が回路図シンボルピンの数を超えているフットプリントごとに 1 つずつです。

Number of Pads exceeds Number of Pins 違反のデフォルトモードは、Error です。必要に応じて、Preferences ダイアログの Data Management – Component Rule Checks ページで設定できます。

詳細については、Verifying a Component のページをご参照ください。

Item ID を外部の DB パラメータへ照合

データベースコンポーネント同期プロセスで、データベースパラメータを Workspace コンポーネントの Item ID へマップできるようになりました。CmpSync ドキュメントで必要なテーブルが選択されている時、Properties パネルの Parameter Mapping 領域を使用して、ID パラメータをソースデータベースパラメータへマップできます。

詳細については、Component Database to Workspace Data Synchronization のページをご参照ください。

Altium Designer 24.8 で完全に公開された機能

以下の機能は、このバージョンで正式に公開されました:

Ability to Disable Automatic Update of Drill Symbol Data – 24.6 から利用可能

Altium Designer 24.7

リリース日: 2024年7月23日 – バージョン 24.7.2 (build 38)

Altium Designer のリリースノート

回路図の改善

マルチパートコンポーネントの機能強化

マルチパートコンポーネントで 1 つのサブパートにのみプリミティブが定義されている場合、そのサブパートを回路図シートに配置すると、デジグネータのサフィックスは非表示になります。これは、alternate 表示モードの場合のみで、サフィックスは Normal 表示モードでは常に表示されます。また、サブパート/モードにプリミティブが無い場合、サブパート (または、alternate 表示モード) を選択できなくなりました。

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デュアルオペアンプコンポーネントの回路図シンボルの例。normal モードでは、コンポーネントが 2 つのサブパートとして示されます。alternate モードでは、コンポーネントが 1 つのサブパートとして示されます。

回路図シートでは、選択された alternate モードでサブパートのみである場合、サブパートのデジグネータサフィックスは表示されません。

サブパートにプリミティブが無い場合、サブパートを選択できなくなりました。

モードにプリミティブが無い場合、alternate 表示モードを選択できなくなりました。

詳細については、Creating a Schematic Symbol のページをご参照ください。

新しいポート違反を追加

Project Options ダイアログの Error Reporting タブの Violations Associated with Nets カテゴリへ新しい違反タイプを追加し、ソース回路図ドキュメント内に対応する/一致するポートが無いフラットデザインのポートを検出できるようになりました。Port with no matching ports エラー違反は、一致するポートが無い場合、またはポートが接続されていない場合に起こります。違反のデフォルトの状態は No Report です。

この違反タイプは、Project Options ダイアログの Options タブの Net Identifier Scope オプションが Flat (Only ports global) 、または Global (Netlabels and ports global) に設定されている場合にのみ検出されます。

詳細については、Verifying Your Design Project のページをご参照ください。

代替部品用にシンボル/フットプリントを変更せずに維持する機能

回路図上のシンボルを変更したり、PCB へフットプリントを追加することなく、代替部品を選択できるようになりました。Properties パネルで、必要に応じて、下図に示す様に、Do not overwrite schematic symbol と/または Do not overwrite PCB footprint オプションを有効にします。選択した代替部品のパラメータは、ActiveBOMに忠実に表示されます。

詳細については、Working with the Variant Manager のページをご参照ください。