Tipos de Regras Elétricas
Altium Essentials: PCB Design Rules Creation
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Num relance
- Saiba como a regra de afastamento define o espaçamento entre objetos da PCB, incluindo redes, pares diferenciais, pads, vias, furos e elementos de cobre.
- Veja como usar a Matriz de Afastamento Mínimo, os modos Simples e Avançado e os atalhos de edição para criar regras de afastamento mais específicas.
- Entenda casos especiais de afastamento, como a verificação entre vias e pads SMD da mesma rede, o afastamento entre furos e objetos e o comportamento do afastamento específico por camada.
As regras de projeto da categoria Electrical são descritas abaixo.

A categoria Electrical de regras de projeto.
Saiba mais sobre Definição, escopo e gerenciamento de regras de projeto de PCB.
Folga
Esta regra define a folga mínima permitida entre quaisquer dois objetos primitivos em uma camada de cobre. É possível especificar um único valor de folga ou diferentes folgas para diferentes pares de objetos, usando uma Minimum Clearance Matrix dedicada. Esta última opção, em combinação com a definição do escopo das regras, oferece a flexibilidade necessária para criar um conjunto conciso e direcionado de regras de folga que atenda até mesmo aos requisitos mais rigorosos.
Restrições
Configurações da restrição de folga
| Regra padrão | Obrigatório |
| Connective Checking | O conjunto de objetos de rede retornado pelo escopo da regra pode ser ainda mais restringido usando a lista suspensa na parte superior da região de restrições , das seguintes maneiras:
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| Ignore Pad to Pad Clearances within a footprint | Ative ou desative esta opção para especificar se as folgas entre pads no mesmo footprint de componente serão ignoradas. Esta opção fica desabilitada por padrão. |
| Minimum Clearance | O valor da folga mínima exigida. Um valor inserido aqui será replicado em todas as células da matriz de folga mínima. Por outro lado, quando um valor de folga diferente for inserido para um ou mais pares de objetos na matriz, a restrição Minimum Clearance mudará para N/A, para indicar que um único valor de folga não está sendo aplicado a todos os pares. |
| Minimum Clearance Matrix | Permite ajustar com precisão os espaçamentos entre as diversas combinações de objetos no projeto. |
| Simple/Advanced options | Na Matriz de Espaçamento Mínimo, o modo Simple é o modo padrão No modo Advanced todos os objetos são apresentados (esta é a matriz tradicional).
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| Edição na Matriz de Espaçamento | A definição dos valores de espaçamento na matriz pode ser realizada das seguintes maneiras:
Dicas para trabalhar com a matriz:
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| Verificação de espaçamento de polígonos |
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| Verificação de folga entre furos e objetos | Os projetistas podem verificar as folgas entre as bordas dos furos e os objetos de cobre vizinhos nas camadas de sinal. Isso é particularmente útil para evitar o roteamento de trilhas muito próximas a um furo, pois elas poderiam ser afetadas por um possível desvio da broca durante a fabricação da placa. A linha na parte inferior da matriz de folgas mínimas da regra Clearance é usada para definir as folgas desejadas Defina valores de folga para identificar quaisquer objetos de cobre no projeto que estejam muito próximos das bordas dos furos. |
| Verificação de folga entre planos divididos | Esta regra também pode verificar as folgas entre regiões de planos divididos nas camadas de planos internos. A forma como a folga é definida depende do modo em que você está usando a matriz de folgas mínimas:
Uma violação será exibida no formato: Clearance Constraint: (<CurrentClearance> < <DefinedClearance>) Between Split Plane (<NetName>) on <InternalPlaneLayerName> And Split Plane (<NetName>) on <InternalPlaneLayerName>, por exemplo : Clearance Constraint: (32.36mil < 34mil) Between Split Plane (GND) on Internal Plane 1 And Split Plane (NetC6) on Internal Plane 1 |
| Verificação de folga de pares diferenciais | Os pares diferenciais apresentam desafios de projeto específicos, muitas vezes exigindo uma folga
Saiba mais sobre Roteamento de pares diferenciais. Saiba mais sobre a definição do escopo das regras de projeto de pares diferenciais. |
| Verificação de folga por camada | Por padrão, a verificação de folga se aplica a todas as camadas do projeto. Se as restrições de projeto forem definidas em Constraint Manager, a folga também poderá ser restringida por camada
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| Evite tornar a verificação de folga mais lenta | Durante o roteamento (e operações semelhantes), o mecanismo de regras verifica constantemente a presença de obstáculos ao redor do ponto de edição. A área examinada inclui a área da primitiva mais a área de folga necessária ao redor dessa primitiva. Isso significa que, quanto maior a folga definida nas regras, maior será a área que precisa ser examinada e, portanto, mais lenta será a operação. Se uma folga grande for necessária apenas para um pequeno número de objetos, você poderá evitar tornar o mecanismo de roteamento mais lento adicionando uma área de restrição ao redor desses objetos específicos, em vez de definir uma regra de folga grande para eles. |
| Verificação de folga em um projeto de eletrônica impressa |
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| Aplicação da regra | DRC online, DRC em lote, roteamento interativo, roteamento automático e posicionamento de polígonos. |
Curto-circuito
Esta regra verifica a existência de curtos-circuitos entre objetos primitivos nas camadas de cobre (de sinal e de plano). Um curto-circuito ocorre quando dois objetos com nomes de rede diferentes se tocam.
Restrições
Configurações de restrição de curto-circuito
| Regra padrão | Obrigatória |
| Allow Short Circuit | Define se as redes de destino abrangidas pelos dois escopos (consultas completas) da regra podem ou não ser conectadas em curto-circuito. Se você precisar conectar duas redes diferentes em curto-circuito, por exemplo, ao conectar dois sistemas de terra em um projeto, certifique-se de que esta opção esteja habilitada. |
| Em um projeto de eletrônica impressa | Em um projeto de eletrônica impressa, quando redes diferentes se cruzam em camadas diferentes, elas são sinalizadas como um curto-circuito. Esses cruzamentos são isolados posicionando uma região dielétrica em uma camada não condutora. |
| Em um projeto de ligação por fios | Esta regra também se aplica à ligação por fios. Uma violação ocorre quando um fio de ligação é conectado a um pad do die ou a uma região de cobre de uma rede diferente ou quando as extremidades de fios de ligação de redes diferentes são conectadas. |
| Aplicação da regra | DRC online, DRC em lote e durante o roteamento automático. |
Rede não roteada
O sistema de verificação de regras de projeto do Editor de PCB normalmente considera uma rede roteada se todos os nós dessa rede (pads de componentes) estiverem conectados por meio de objetos de projeto associados a redes (trilhas, arcos, pads, vias e polígonos). Esses objetos são considerados conectados quando se tocam. No entanto, embora o simples contato seja interpretado pelo software como uma conexão, no momento de fabricar a placa, a fragilidade de algumas dessas “conexões” pode causar problemas críticos, especialmente quando os objetos — por exemplo, dois segmentos de trilha contíguos ou uma trilha que entra em um pad/via — apenas se tocam ligeiramente. Essas conexões costumam ser chamadas de “conexões ruins”, “conexões deficientes” ou “conexões incompletas”. Use esta regra para verificar a existência dessas conexões deficientes.
Restrições
Configurações de restrição de rede não roteada
| Regra padrão | Obrigatória |
| Routing completion | Esta regra verifica o estado de conclusão de cada rede que se enquadra no escopo (consulta completa) da regra. Se uma rede estiver incompleta, cada seção concluída (sub-rede) será listada junto com a conclusão do roteamento. A conclusão do roteamento é definida como:
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| Check for incomplete connections | Com esta opção habilitada, são realizadas as seguintes verificações adicionais de conectividade entre os objetos de projeto aplicáveis:
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| Como as falhas são identificadas |
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| Interação com outras regras | Algumas verificações de DRC exigem que a regra Rede não roteada esteja habilitada para verificação em lote para funcionarem. |
| Em um projeto de eletrônica impressa | Na eletrônica impressa, as transições entre camadas not exigem uma via; o analisador de redes reconhecerá que a rede não está interrompida se uma via for removida de uma rede roteada. Uma placa é definida como eletrônica impressa quando a opção Printed Electronics está habilitada no Gerenciador de Empilhamento de Camadas. Saiba mais sobre Eletrônica impressa. |
| Em um projeto com ligação por fios | Esta regra também se aplica à Ligação por fios. Uma violação ocorre quando não há conexão entre pads do die, fios de ligação e/ou objetos de cobre da mesma rede. |
| Aplicação da regra | DRC em lote. |
Pino não conectado
Esta regra detecta pinos que não têm uma rede atribuída nem trilhas conectadas.
Restrições
Configurações de restrições de pino não conectado
| Regra padrão | Não obrigatória |
| Configurações | Nenhuma |
| Aplicação da regra | DRC on-line e DRC em lote. |
Polígono modificado
Esta regra detecta polígonos que ainda estão suspensos e/ou foram modificados, mas cujo preenchimento ainda não foi recalculado.
Restrições
Configurações de restrições de polígono modificado
| Regra padrão | Obrigatória |
| Allow shelved | Se habilitada, todos os polígonos que se enquadram no escopo desta regra de projeto e que estão atualmente suspensos não serão sinalizados como uma violação. |
| Allow modified | Se habilitada, todos os polígonos que se enquadram no escopo desta regra de projeto e que estão atualmente modificados, mas cujo preenchimento não foi recalculado, não serão sinalizados como uma violação. |
| Aplicação da regra | DRC on-line e DRC em lote. |
Distância de escoamento
Esta regra verifica a distância de escoamento entre os sinais especificados ao longo da superfície da placa, passando por furos não metalizados, recortes e ao redor da borda da placa.
Restrições
Configurações de restrições de distância de escoamento
| Regra padrão | Não obrigatória. |
| Creepage distance | Uma violação de regra é sinalizada quando a distância entre qualquer ponto do Primeiro objeto e qualquer ponto do Segundo objeto é igual ou inferior à distância especificada. |
| Ignore Internal Layers | Use esta opção para garantir que a regra seja aplicada apenas às camadas externas. |
| Apply to Polygon Pour | Use esta opção para aplicar a regra aos polígonos incluídos no escopo. |
| Comportamento padrão | A regra Distância de escoamento não está habilitada por padrão para a verificação de regras de projeto on-line ou em lote. Habilite a verificação on-line/em lote na caixa de diálogo Design Rule Checker Também pode ser necessário configurar a exibição das violações de regras. Os Detalhes da violação (informações localizadas sobre a violação) e/ou a Sobreposição de violação (realce de todos os objetos em violação) são habilitados na página PCB Editor – DRC Violations Display da caixa de diálogo Preferences |
| Resultados | A regra identifica os pontos mais próximos nas redes especificadas e verifica a distância entre eles nos planos X, Y e Z. |
| Pad com furo oblongo | Se um rasgo na placa tiver sido criado pela colocação de um pad, certifique-se de que a opção Plated esteja desabilitada nas propriedades do pad, pois o software considera que a parede metalizada do furo é condutora e reduzirá a distância de escoamento de acordo com isso. |
| Comportamento do polígono | Se um preenchimento de polígono e outros objetos estiverem no escopo de uma regra de projeto Distância de escoamento com a opção Apply to Polygon Pour habilitada e de uma regra de projeto de folga, ambas as regras serão consideradas, e o maior valor será aplicado ao preencher o polígono. Por exemplo, se a regra Distância de escoamento tiver um valor de restrição maior que o da regra de Folga, esse valor maior será aplicado. |
| Aplicação da regra | DRC on-line, DRC em lote e durante o roteamento automático. |
Folga no eixo Z
Esta regra verifica as folgas mínimas entre várias primitivas em diferentes camadas de cobre.
Restrições
Configurações de restrição de folga no eixo Z
| Regra padrão | Não obrigatória. |
| Z-Axis Clearance | Uma violação de regra é sinalizada quando a distância entre qualquer ponto do primeiro objeto e qualquer ponto do segundo objeto é igual ou inferior à distância especificada, quando o primeiro e o segundo objetos estão posicionados em diferentes camadas de cobre. |
| Exibição de violações | Com a exibição de Violation Details habilitada para a página PCB Editor – DRC Violations Display da caixa de diálogo Preferences , o texto de uma violação no espaço de projeto da PCB é apresentado no formato:
em que Em outros locais do software, é utilizado o seguinte formato:
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| Suporte a polígonos | A regra é compatível com preenchimentos de polígonos (sólidos e hachurados) e planos internos. Observe que as áreas vazias são criadas nos polígonos somente quando uma violação é detectada entre um polígono e objetos de outros tipos (trilhas, ilhas de solda etc.). Embora as folgas e as violações sejam detectadas entre preenchimentos de polígonos em diferentes camadas de sinal, as áreas vazias não são criadas automaticamente nesse caso. |
| Suporte a camadas de plano | Embora as folgas e as violações sejam detectadas entre objetos (posicionados em camadas de sinal) e planos internos (pela menor distância), essas violações devem ser resolvidas manualmente. |
| Salvamento em um formato de arquivo mais antigo | Ao abrir uma PCB que contenha regras/restrições de folga no eixo Z definidas em uma versão mais antiga do Altium Designer que não ofereça suporte a esse recurso, as regras serão perdidas. |
| Aplicação da regra | DRC on-line, DRC em lote. |


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